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H9CKNNN8GTMPLR-NUH の電気的特性と機能

H9CKNNN8GTMPLR-NUHのメーカーはHynixです、この部品の機能は「8Gb LPDDR3」です。


製品の詳細 ( Datasheet PDF )

部品番号 H9CKNNN8GTMPLR-NUH
部品説明 8Gb LPDDR3
メーカ Hynix
ロゴ Hynix ロゴ 




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H9CKNNN8GTMPLR-NUH Datasheet, H9CKNNN8GTMPLR-NUH PDF,ピン配置, 機能
168ball FBGA Specification
8Gb LPDDR3 (x32)
This document is a general product description and is subject to change without notice. SK hynix does not assume any responsibility
for use of circuits described. No patent licenses are implied.
Rev 1.1 / Oct. 2013
1

1 Page





H9CKNNN8GTMPLR-NUH pdf, ピン配列
H9CKNNN8GTMPLR
LPDDR3-S8B 8Gb(x32)
FEATURES
[ FBGA ]
Operation Temperature
- (-30)oC ~ 105oC
Package
- 168-ball FBGA - 12.0x12.0mm2, 0.70t, 0.50mm pitch
- Lead & Halogen Free
[ LPDDR3 ]
VDD1 = 1.8V (1.7V to 1.95V)
VDD2, VDDCA and VDDQ = 1.2V (1.14V to 1.30)
HSUL_12 interface (High Speed Unterminated Logic 1.2V)
Double data rate architecture for command, address and data Bus;
- all control and address except CS_n, CKE latched at both rising and falling edge of the clock
- CS_n, CKE latched at rising edge of the clock
- two data accesses per clock cycle
Differential clock inputs (CK_t, CK_c)
Bi-directional differential data strobe (DQS_t, DQS_c)
- Source synchronous data transaction aligned to bi-directional differential data strobe (DQS_t, DQS_c)
- Data outputs aligned to the edge of the data strobe (DQS_t, DQS_c) when READ operation
- Data inputs aligned to the center of the data strobe (DQS_t, DQS_c) when WRITE operation
DM masks write data at the both rising and falling edge of the data strobe
Programmable RL (Read Latency) and WL (Write Latency)
Programmable burst length: 8
Auto refresh and self refresh supported
All bank auto refresh and per bank auto refresh supported
Auto TCSR (Temperature Compensated Self Refresh)
PASR (Partial Array Self Refresh) by Bank Mask and Segment Mask
DS (Drive Strength)
DPD (Deep Power Down)
ZQ (Calibration)
ODT (On Die Termination)
Rev 1.1 / Oct. 2013
3


3Pages


H9CKNNN8GTMPLR-NUH 電子部品, 半導体
Ball ASSIGNMENT
H9CKNNN8GTMPLR
LPDDR3-S8B 8Gb(x32)
1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23
A ADNU DNU NC
NC
NC
NC
NC
NC
NC
NC
VDD1
VSSQ
DQ30
DQ29
VSSQ
DQ26
DQ25
VSSQ
DQS3_
c
VDD1
VSS
DNU
DNU
B BDNU DNU VDD1 NC
NC
NC
NC
NC
NC
VSS
VDD2 DQ31 VDDQ DQ28
DQ27
VDDQ
DQ24
DQS3_
t
VDDQ
DM3
VDD2
DNU
DNU
C VSS VDD2
DQ15 VSSQ
C
D NC NC
VDDQ DQ14
D
E NC NC
DQ12 DQ13
E
F NC NC
DQ11 VSSQ
F
G NC NC
VDDQ DQ10
G
H NC NC
DQ8 DQ9
H
J NC NC
K NC NC
L NC NC
Top View
DQS1_
t
VSSQ
VDDQ
DQS1_
c
VDD2 DM1
J
K
L
M NC VSS
VREF
(DQ)
VSS
M
N NC VDD1
P
ZQ
VREF
(CA)
R VSS VDD2
168ball 12x12 PoP
x32 LPDDR3 only
VDD1 DM0
DQS0_
c
VSSQ
VDDQ
DQS0_
t
N
P
R
T CA9 CA8
DQ6 DQ7
T
U CA7 VDDCA
DQ5 VSSQ
U
V VSSCA CA6
VDDQ DQ4
V
W CA5 VDDCA
DQ2 DQ3
W
Y CK_c CK_t
DQ1 VSSQ
Y
AA VSS VDD2
VDDQ DQ0 AA
AB
AC
DNU DNU CS0
NC VDD1 CA1 VSSCA CA3
CA4
VDD2
VSS
DQ16 VDDQ DQ18
DQ20
VDDQ
DQ22
DQS2_
t
VDDQ
DM2
VDD2
DNU
DNU
DNU DNU CKE0 NC
VSS CA0 CA2 VDDCA NC
NC
NC
VSSQ
DQ17
DQ19
VSSQ
DQ21
DQ23
VSSQ
DQS2_
c
VDD1
VSS
DNU DNU
AB
AC
1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23
LPDDR3 Commend / Address
Power (LPDDR3 : VDD1,VDD2,VDDCA,VREF)
LPDDR3 Data IO
Ground (LPDDR3 : VSS,VSSCA,VSSQ)
Rev 1.1 / Oct. 2013
6

6 Page



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[ H9CKNNN8GTMPLR-NUH データシート.PDF ]


データシートを活用すると、その部品の主な機能と仕様を詳しく理解できます。 ピン構成、電気的特性、動作パラメータ、性能を確認してください。


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部品番号部品説明メーカ
H9CKNNN8GTMPLR-NUH

8Gb LPDDR3

Hynix
Hynix


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