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HM5225645FのメーカーはHitachi Semiconductorです、この部品の機能は「256M LVTTL interface SDRAM 100 MHz 1-Mword x 64-bit x 4-bank/2-Mword x 32-bit x 4-bank PC/100 SDRAM」です。 |
部品番号 | HM5225645F |
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部品説明 | 256M LVTTL interface SDRAM 100 MHz 1-Mword x 64-bit x 4-bank/2-Mword x 32-bit x 4-bank PC/100 SDRAM | ||
メーカ | Hitachi Semiconductor | ||
ロゴ | |||
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HM5225645F-B60
HM5225325F-B60
256M LVTTL interface SDRAM
100 MHz
1-Mword × 64-bit × 4-bank/2-Mword × 32-bit × 4-bank
PC/100 SDRAM
ADE-203-1014C (Z)
Rev. 1.0
Oct. 1, 1999
Description
The Hitachi HM5225645F is a 256-Mbit SDRAM organized as 1048576-word × 64-bit × 4-bank. The Hitachi
HM5225325F is a 256-Mbit SDRAM organized as 2097152-word × 32-bit × 4-bank. All inputs and outputs
are referred to the rising edge of the clock input. It is packaged in standard 108 bump BGA.
Features
• Single chip wide bit solution (× 64/× 32)
• 3.3 V power supply
• Clock frequency: 100 MHz (max)
• LVTTL interface
• Extremely small foot print: 1.27 mm pitch
Package: BGA (BP-108)
• 4 banks can operate simultaneously and independently
• Burst read/write operation and burst read/single write operation capability
• Programmable burst length: 4/8/full page
• 2 variations of burst sequence
Sequential (BL = 4/8/full page)
Interleave (BL = 4/8)
• Programmable CAS latency: 2/3
• Byte control by DQMB
1 Page Pin Arrangement (HM5225645F)
HM5225645F-B60, HM5225325F-B60
108-bump BGA
1 2 34 5 67 8 9
A DQ63 DQ62 DQ49 DQ48 VSS DQ47 DQ46 DQ33 DQ32
B DQ61 DQ60 DQ51 DQ50 VCC DQ45 DQ44 DQ35 DQ34
C DQ59 DQ58 DQ53 DQ52 VCC DQ43 DQ42 DQ37 DQ36
D DQ57 DQ56 DQ55 DQ54 VSS DQ41 DQ40 DQ39 DQ38
E
DQ
MB7
DQ
MB6
DQ DQ
MB5 MB4
F CKE VCC
RAS WE
G A12 VCC
A10 A13
H A7 A5
VCC A1
J A4 VSS
A2 A3
K A8 A6
VSS A0
L A11 VSS
A9 CS
M Open CLK
VCC CAS
N
DQ
MB0
DQ
MB1
DQ DQ
MB2 MB3
P DQ6 DQ7 DQ8 DQ9 VSS DQ22 DQ23 DQ24 DQ25
R DQ4 DQ5 DQ10 DQ11 VCC DQ20 DQ21 DQ26 DQ27
T DQ2 DQ3 DQ12 DQ13 VCC DQ18 DQ19 DQ28 DQ29
U DQ0 DQ1 DQ14 DQ15 VSS DQ16 DQ17 DQ30 DQ31
(Top view)
3
3Pages HM5225645F-B60, HM5225325F-B60
Pin Description (HM5225325F)
Pin name
Function
A0 to A13
Address input
Row address A0 to A11
Column address A0 to A8
Bank select address A12/A13 (BS)
DQ0 to DQ31
Data-input/output
CS Chip select
RAS
Row address strobe command
CAS
Column address strobe command
WE Write enable
DQMB0 to DQMB3
Byte data mask*1
CLK Clock input
CKE
Clock enable
VCC
VSS
Open
Power supply
Ground
Open*2
NC No connection*3
Note:
1. DQMB0: DQ0 to DQ7
DQMB1: DQ8 to DQ15
DQMB2: DQ16 to DQ23
DQMB3: DQ24 to DQ31
2. Don’t connect. Internally connected with die.
3. Not internally connected with die.
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ページ | 合計 : 16 ページ | ||
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PDF ダウンロード | [ HM5225645F データシート.PDF ] |
データシートを活用すると、その部品の主な機能と仕様を詳しく理解できます。 ピン構成、電気的特性、動作パラメータ、性能を確認してください。 |
部品番号 | 部品説明 | メーカ |
HM5225645F | 256M LVTTL interface SDRAM 100 MHz 1-Mword x 64-bit x 4-bank/2-Mword x 32-bit x 4-bank PC/100 SDRAM | Hitachi Semiconductor |
HM5225645F-B60 | 256M LVTTL interface SDRAM 100 MHz 1-Mword x 64-bit x 4-bank/2-Mword x 32-bit x 4-bank PC/100 SDRAM | Hitachi Semiconductor |